高速信号传播延迟 (Propagation Delay) 与等长 Skew 计算器
在 DDR3 / DDR4 / DDR5、PCIe 4.0/5.0、USB3.2、MIPI 及千兆网线布线中，传输线结构与介电常数决定了电信号在 PCB 上的传播速度。本工具计算表层/内层走线的每毫米传输延迟 $T_{pd}$，并根据总线数据速率自动给出容许的走线等长误差公差 ($\Delta L$)。
常见：FR-4 ≈ 4.2–4.5；Megtron 6 ≈ 3.6；Rogers 4350B ≈ 3.48
一般总线建议取 2%–5% 个单位时间 UI (Unit Interval)
计算结果
| 单位长度传输延迟 Tpd | — ps/mm (— ps/inch) |
| PCB 上信号传输速度 v | — mm/ps (约 — c) |
| 单位时间周期 UI / 比特持续时间 | — ps |
| 允许的最大 Timing Skew 时延差 | — ps |
| 建议走线等长匹配公差 ΔL | — mm (— mil) |
| 蛇形线绕线 (Meander) 避让建议 | — |
计算公式：
表层微带线有效介电常数：$$\epsilon_{eff} \approx 0.475 \times \epsilon_r + 0.67$$
内层带状线有效介电常数：$$\epsilon_{eff} \approx \epsilon_r$$
$$T_{pd} = \frac{\sqrt{\epsilon_{eff}}}{c} \approx 3.333 \times \sqrt{\epsilon_{eff}} \quad [\text{ps/mm}]$$
$$\Delta L = \frac{\text{Skew (ps)}}{T_{pd} \text{ (ps/mm)}}$$
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